verilog规定，always@(*)中的*是指该always块内的所有输入信号的变化为敏感列表，也就是仿真时只有当always@(*)块内的输入信号产生变化，该 …
时钟在always模块中不再出现（时钟信号在敏感信号作用下的值一直相等，没有使用在内部的意义，当然可以转化后使用）。 而对于使能信号，则是会有 …